Diskussion:VHDL

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[Bearbeiten] Struktur

IMO sollte man Beispiele, Code-Referenz und Allgmeines zu HDL trennen und in Unterartikel verschieben.

[Bearbeiten] CLK='1' and CLK'event oder rising_edge()?

Siehe dazu Mikrocontroller.net FAQ-Eintrag

IMO sollte man rising_edge() verwenden.

[Bearbeiten] assert

assert (a > c) wird meiner Meinung nach nur ausgelöst wenn a <= c ist. Daher ist die aussage "a zu gross" falsch, oder?

Siehe: http://www.nt-nv.fh-koeln.de/Labor/VhdlEnglish/Kap5/k54.html

MfG Chytos

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